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Module RMA Watlow EZ-ZONE

• 69 • Chapitre8 Annexe

15 14 13 12 11 10 9 8 7 6 5 4 3 2 1 0

État

d’erreur

d’entrée

État

d’erreur

de boucle

État

de réglage

15 14 13 12 11 10 9 8 7 6 5 4 3 2 1 0

État

d’erreur

d’entrée

15 14 13 12 11 10 9 8 7 6 5 4 3 2 1 0

Non utilisé

État

d’erreur

d’entrée

Non utilisé

État

d’erreur

d’entrée

Non utilisé

État

d’erreur

d’entrée

Non

utilisé

État

d’erreur

d’entrée

Non

utilisé

État

d’erreur

d’entrée

Non

utilisé

État

d’erreur

d’entrée

Non

utilisé

État

d’erreur

d’entrée

Non

utilisé

État

d’erreur

d’entrée

15 14 13 12 11 10 9 8 7 6 5 4 3 2 1 0

État

d’erreur

d’entrée

15 14 13 12 11 10 9 8 7 6 5 4 3 2 1 0

non utilisé

Suppression

boucle

ouverte

Initialisation

du réglage

Bits 0 à 15: ce membre a créé des paires de bits qui représentent l’état de 16alarmes au maximum (00 = Aucune, 01 = Alarme basse,

10 = Alarme haute, 11 = Autre) = Alarme inférieure, 10 = Alarme supérieure, 11 = Autre)

Bits 14 à 15: état de limite (00 = Aucune, 01 = Limite inférieure, 10 = Limite supérieure, 11 = Autre)

Bits 0 à 12: 13bits, signés, entier (-4096 à 4095)

Bits 13 et 29: état d’erreur d’entrée analogique (0 = Aucune, 1 = Erreur)

Bits 0, 2, 4, 6, 8, 10, 12 et 14: reﬂète l’état d’erreur d’entrée analogique pour l’instance i à l’instance i+15 respectivement (0 = Aucune, 1 = Erreur)

instance i + 15 respectively (0 = Aucune, 1 = Erreur)

État de limite État de limiteÉtat de limite État de limiteÉtat de limite

État d’alarme

Bits 0 à 15: ce membre a créé des paires de bits qui représentent l’état de 16limites au maximum (00 = Aucune, 01 = Limite inférieure,

10 = Limite supérieure, 10 = Limite supérieure,

État de limite

État d’alarme État d’alarmeÉtat d’alarme État d’alarme

Mode de

contrôle

Point de consigne de boucle ouverte (instancei)

Valeur d’entrée analogique ﬁltrée (instancei)

État d’alarme État d’alarme

Bits 0 à 14: 15bits signés avec une précision supposée au dixième (-1638,4 à 1638,3)

Puissance de sortie de la boucle de contrôle (instancei)CM réel

Bits 0 à 10: 10bits signés avec une précision supposée au dixième (-100,0 à 100,0)

Bit11: état de réglage de boucle (0 = Désactivé, 1 = Erreur)

État de limite Valeur d’entrée analogique (instancei)

Bits 12 et 13: mode de contrôle réel (00 = Désactivé, 01 = Manuel, 10 = Auto)

Bit15: état d’erreur d’entrée analogique (0 = Aucune, 1 = Erreur)

Bit 14: état d’erreur de boucle (0 = Aucune, 1 = Erreur)

Bit15: état d’erreur d’entrée analogique (0 = Aucune, 1 = Erreur)

Bits 0 à 15: 16bits signés avec une précision supposée au dixième (-3276,8 à 3276,7)

Bits 0 à 10: 10bits signés avec une précision supposée au dixième (-100,0 à 100,0)

Bits 12 et 13: mode de contrôle (00 = Désactivé, 01 = Manuel, 10 = Auto)

Bit 14: suppression d’une condition de boucle ouverte (0 = Ignorer, 1 = Supprimer)

État d’alarme

État de limiteÉtat de limite

Classe compacte LSWA

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